dts: bindings: gpio: use hyphens instead of underscore
replace underscore with hyphens to comply with device tree spec Signed-off-by: Jilay Pandya <jilay.pandya@outlook.com>
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c5aed65a54
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@ -34,9 +34,9 @@
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compatible = "snps,creg-gpio";
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reg = <0xf0000014 0x4>;
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ngpios = <6>;
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bit_per_gpio = <1>;
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off_val = <0>;
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on_val = <1>;
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bit-per-gpio = <1>;
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off-val = <0>;
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on-val = <1>;
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gpio-controller;
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#gpio-cells = <2>;
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@ -135,9 +135,9 @@
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compatible = "snps,creg-gpio";
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reg = <0xf00014b0 0x4>;
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||||
ngpios = <12>;
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||||
bit_per_gpio = <2>;
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||||
off_val = <0>;
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on_val = <2>;
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||||
bit-per-gpio = <2>;
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||||
off-val = <0>;
|
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on-val = <2>;
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||||
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||||
gpio-controller;
|
||||
#gpio-cells = <2>;
|
||||
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@ -135,9 +135,9 @@
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|||
compatible = "snps,creg-gpio";
|
||||
reg = <0xf00014b0 0x4>;
|
||||
ngpios = <12>;
|
||||
bit_per_gpio = <2>;
|
||||
off_val = <0>;
|
||||
on_val = <2>;
|
||||
bit-per-gpio = <2>;
|
||||
off-val = <0>;
|
||||
on-val = <2>;
|
||||
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||||
gpio-controller;
|
||||
#gpio-cells = <2>;
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||||
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@ -97,7 +97,7 @@
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|||
gpio-controller;
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||||
#gpio-cells = <2>;
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||||
ngpios = <16>;
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||||
vbatts_pins = <2 3 4>;
|
||||
vbatts-pins = <2 3 4>;
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||||
status = "disabled";
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};
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||||
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||||
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@ -11,7 +11,7 @@ properties:
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reg:
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||||
required: true
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||||
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||||
pin_mask:
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||||
pin-mask:
|
||||
type: int
|
||||
required: true
|
||||
description: |
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@ -21,7 +21,7 @@ properties:
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NCT3808: <0xdc>
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others: <0xff>
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||||
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||||
pinmux_mask:
|
||||
pinmux-mask:
|
||||
type: int
|
||||
description: |
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||||
NCT38XX series port 0 has Pin Multiplexing functionality. However, not
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||||
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@ -23,8 +23,8 @@ description: |
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|||
gpio-controller;
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||||
#gpio-cells = <2>;
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||||
ngpios = <8>;
|
||||
pin_mask = <0xff>;
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||||
pinmux_mask = <0xf7>;
|
||||
pin-mask = <0xff>;
|
||||
pinmux-mask = <0xf7>;
|
||||
};
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||||
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||||
gpio@1 {
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||||
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@ -33,7 +33,7 @@ description: |
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|||
gpio-controller;
|
||||
#gpio-cells = <2>;
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||||
ngpios = <8>;
|
||||
pin_mask = <0xff>;
|
||||
pin-mask = <0xff>;
|
||||
};
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||||
};
|
||||
};
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||||
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@ -53,8 +53,8 @@ description: |
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|||
gpio-controller;
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||||
#gpio-cells = <2>;
|
||||
ngpios = <8>;
|
||||
pin_mask = <0xdc>;
|
||||
pinmux_mask = <0xff>;
|
||||
pin-mask = <0xdc>;
|
||||
pinmux-mask = <0xff>;
|
||||
};
|
||||
};
|
||||
};
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||||
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@ -74,8 +74,8 @@ description: |
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|||
gpio-controller;
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||||
#gpio-cells = <2>;
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||||
ngpios = <8>;
|
||||
pin_mask = <0xdc>;
|
||||
pinmux_mask = <0xff>;
|
||||
pin-mask = <0xdc>;
|
||||
pinmux-mask = <0xff>;
|
||||
};
|
||||
};
|
||||
};
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||||
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@ -15,7 +15,7 @@ properties:
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|||
type: int
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||||
required: true
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||||
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||||
vbatts_pins:
|
||||
vbatts-pins:
|
||||
type: array
|
||||
description: Array of vbatt pin on port
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||||
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||||
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@ -11,15 +11,15 @@ properties:
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|||
reg:
|
||||
required: true
|
||||
|
||||
bit_per_gpio:
|
||||
bit-per-gpio:
|
||||
type: int
|
||||
required: true
|
||||
|
||||
off_val:
|
||||
off-val:
|
||||
type: int
|
||||
required: true
|
||||
|
||||
on_val:
|
||||
on-val:
|
||||
type: int
|
||||
required: true
|
||||
|
||||
|
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|
@ -172,8 +172,8 @@
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|||
gpio-controller;
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||||
#gpio-cells = <2>;
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||||
ngpios = <8>;
|
||||
pin_mask = <0xff>;
|
||||
pinmux_mask = <0xf7>;
|
||||
pin-mask = <0xff>;
|
||||
pinmux-mask = <0xf7>;
|
||||
};
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||||
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||||
gpio@1 {
|
||||
|
@ -182,7 +182,7 @@
|
|||
gpio-controller;
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||||
#gpio-cells = <2>;
|
||||
ngpios = <8>;
|
||||
pin_mask = <0xff>;
|
||||
pin-mask = <0xff>;
|
||||
};
|
||||
};
|
||||
};
|
||||
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@ -201,8 +201,8 @@
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|||
gpio-controller;
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||||
#gpio-cells = <2>;
|
||||
ngpios = <8>;
|
||||
pin_mask = <0xdc>;
|
||||
pinmux_mask = <0xff>;
|
||||
pin-mask = <0xdc>;
|
||||
pinmux-mask = <0xff>;
|
||||
};
|
||||
};
|
||||
};
|
||||
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@ -221,8 +221,8 @@
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|||
gpio-controller;
|
||||
#gpio-cells = <2>;
|
||||
ngpios = <8>;
|
||||
pin_mask = <0xdc>;
|
||||
pinmux_mask = <0xff>;
|
||||
pin-mask = <0xdc>;
|
||||
pinmux-mask = <0xff>;
|
||||
};
|
||||
};
|
||||
};
|
||||
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