drivers: gpio: esp32: Add ESP32 GPIO driver
This provides basic GPIO support, with interrupts, and the ability to read and write to ports on a pin-by-pin basis. Jira: ZEP-2286 Signed-off-by: Leandro Pereira <leandro.pereira@intel.com>
This commit is contained in:
Leandro Pereira
Andrew Boie
parent
f3b05c6a58
commit
c0c79a8041
6 changed files with 395 additions and 0 deletions
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@ -27,6 +27,7 @@ PROVIDE ( __stack = 0x3ffe3f20 );
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PROVIDE ( uart_tx_one_char = 0x40009200 );
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PROVIDE ( uart_tx_one_char = 0x40009200 );
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||||||
PROVIDE ( uart_rx_one_char = 0x400092d0 );
|
PROVIDE ( uart_rx_one_char = 0x400092d0 );
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||||||
PROVIDE ( uartAttach = 0x40008fd0 );
|
PROVIDE ( uartAttach = 0x40008fd0 );
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PROVIDE ( intr_matrix_set = 0x4000681c );
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MEMORY
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MEMORY
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{
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{
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@ -19,3 +19,6 @@ CONFIG_XTENSA_USE_CORE_CRT1=n
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CONFIG_PINMUX=y
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CONFIG_PINMUX=y
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CONFIG_PINMUX_ESP32=y
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CONFIG_PINMUX_ESP32=y
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CONFIG_GPIO=y
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CONFIG_GPIO_ESP32=y
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@ -63,4 +63,6 @@ source "drivers/gpio/Kconfig.fe310"
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source "drivers/gpio/Kconfig.cc2650"
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source "drivers/gpio/Kconfig.cc2650"
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source "drivers/gpio/Kconfig.esp32"
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endif # GPIO
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endif # GPIO
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44
drivers/gpio/Kconfig.esp32
Normal file
44
drivers/gpio/Kconfig.esp32
Normal file
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@ -0,0 +1,44 @@
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# Kconfig.esp32 - ESP32 GPIO configuration options
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#
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#
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# Copyright (c) 2017 Intel Corporation
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#
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# SPDX-License-Identifier: Apache-2.0
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#
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menuconfig GPIO_ESP32
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bool "ESP32 GPIO"
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depends on GPIO && SOC_ESP32
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default n
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help
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Enables the ESP32 GPIO driver
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if GPIO_ESP32
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config GPIO_ESP32_IRQ
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int "IRQ line for ESP32 GPIO pins"
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default 10
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config GPIO_ESP32_0
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bool "ESP32 GPIO (pins 0-31)"
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default y
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help
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Include support for GPIO pins 0-31 on the ESP32.
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config GPIO_ESP32_0_NAME
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string "Driver name"
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depends on GPIO_ESP32_0
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default "GPIO_0"
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config GPIO_ESP32_1
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bool "ESP32 GPIO (pins 32-39)"
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default y
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help
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Include support for GPIO pins 32-39 on the ESP32.
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config GPIO_ESP32_1_NAME
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string "Driver name"
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depends on GPIO_ESP32_1
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default "GPIO_1"
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endif # GPIO_ESP32
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@ -15,3 +15,4 @@ obj-$(CONFIG_GPIO_CC32XX) += gpio_cc32xx.o
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obj-$(CONFIG_GPIO_PULPINO) += gpio_pulpino.o
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obj-$(CONFIG_GPIO_PULPINO) += gpio_pulpino.o
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obj-$(CONFIG_GPIO_FE310) += gpio_fe310.o
|
obj-$(CONFIG_GPIO_FE310) += gpio_fe310.o
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obj-$(CONFIG_GPIO_CC2650) += gpio_cc2650.o
|
obj-$(CONFIG_GPIO_CC2650) += gpio_cc2650.o
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||||||
|
obj-$(CONFIG_GPIO_ESP32) += gpio_esp32.o
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344
drivers/gpio/gpio_esp32.c
Normal file
344
drivers/gpio/gpio_esp32.c
Normal file
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@ -0,0 +1,344 @@
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|
/*
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|
* Copyright (c) 2017 Intel Corporation
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*
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* SPDX-License-Identifier: Apache-2.0
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*/
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#include <rom/ets_sys.h>
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#include <soc/dport_reg.h>
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#include <soc/gpio_reg.h>
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#include <soc/soc.h>
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#include <errno.h>
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#include <device.h>
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#include <gpio.h>
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#include <kernel.h>
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#include <misc/util.h>
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#include <pinmux.h>
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#include "gpio_utils.h"
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struct gpio_esp32_data {
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struct device *pinmux;
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struct {
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struct {
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volatile u32_t *set_reg;
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volatile u32_t *clear_reg;
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} write;
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struct {
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volatile u32_t *reg;
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} read;
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struct {
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volatile u32_t *status_reg;
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volatile u32_t *ack_reg;
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} irq;
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int pin_offset;
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} port;
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u32_t cb_pins;
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sys_slist_t cb;
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};
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static int convert_int_type(int flags)
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{
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/* Reference: "ESP32 Technical Reference Manual", "IO_MUX and
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|
* GPIO matrix"; "GPIO_PINn_INT_TYPE".
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*/
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if (!(flags & GPIO_INT)) {
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return 0; /* Disables interrupt for a pin. */
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}
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if ((flags & GPIO_INT_EDGE) == GPIO_INT_EDGE) {
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|
if ((flags & GPIO_INT_ACTIVE_LOW) == GPIO_INT_ACTIVE_LOW) {
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||||||
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return 2;
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}
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if ((flags & GPIO_INT_DOUBLE_EDGE) == GPIO_INT_DOUBLE_EDGE) {
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return 3;
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}
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|
return 1; /* Defaults to rising edge. */
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|
}
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|
|
||||||
|
if ((flags & GPIO_INT_LEVEL) == GPIO_INT_LEVEL) {
|
||||||
|
if ((flags & GPIO_INT_ACTIVE_LOW) == GPIO_INT_ACTIVE_LOW) {
|
||||||
|
return 4;
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|
}
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|
return 5; /* Defaults to high level. */
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|
}
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|
/* Any other type of interrupt triggering is invalid. */
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|
return -EINVAL;
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|
}
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static inline u32_t *gpio_pin_reg(int pin)
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{
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return (u32_t *)(GPIO_PIN0_REG + pin * 4);
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}
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static int config_interrupt(u32_t pin, int flags)
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{
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volatile u32_t *reg = gpio_pin_reg(pin);
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int type = convert_int_type(flags);
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u32_t v;
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int key;
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if (type < 0) {
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return type;
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}
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key = irq_lock();
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v = *reg;
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v &= ~(GPIO_PIN_INT_ENA_M | GPIO_PIN_INT_TYPE_M);
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/* Bit 3 of INT_ENA will enable interrupts on CPU 0 */
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v |= (1<<2) << GPIO_PIN_INT_ENA_S;
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/* Interrupt triggering mode */
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v |= type << GPIO_PIN_INT_TYPE_S;
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*reg = v;
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irq_unlock(key);
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return 0;
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}
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static void config_polarity(u32_t pin, int flags)
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{
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volatile u32_t *reg = (u32_t *)(GPIO_FUNC0_IN_SEL_CFG_REG + 4 * pin);
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if (flags & GPIO_POL_INV) {
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*reg |= BIT(GPIO_FUNC0_IN_INV_SEL_S);
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} else {
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|
*reg &= ~BIT(GPIO_FUNC0_IN_INV_SEL_S);
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|
}
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|
}
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|
static int gpio_esp32_config(struct device *dev, int access_op,
|
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|
u32_t pin, int flags)
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{
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struct gpio_esp32_data *data = dev->driver_data;
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u32_t func;
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int r;
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||||||
|
if (access_op != GPIO_ACCESS_BY_PIN) {
|
||||||
|
return -ENOTSUP;
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}
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|
/* Query pinmux to validate pin number. */
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|
r = pinmux_pin_get(data->pinmux, pin, &func);
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||||||
|
if (r < 0) {
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|
return r;
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|
}
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|
pinmux_pin_set(data->pinmux, pin, PINMUX_FUNC_A);
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|
if (flags & GPIO_PUD_PULL_UP) {
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||||||
|
pinmux_pin_pullup(data->pinmux, pin, PINMUX_PULLUP_ENABLE);
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||||||
|
} else if (flags & GPIO_PUD_PULL_DOWN) {
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|
pinmux_pin_pullup(data->pinmux, pin, PINMUX_PULLUP_DISABLE);
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||||||
|
}
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||||||
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||||||
|
if (flags & GPIO_DIR_OUT) {
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|
pinmux_pin_input_enable(data->pinmux, pin,
|
||||||
|
PINMUX_OUTPUT_ENABLED);
|
||||||
|
} else {
|
||||||
|
pinmux_pin_input_enable(data->pinmux, pin,
|
||||||
|
PINMUX_INPUT_ENABLED);
|
||||||
|
config_polarity(pin, flags);
|
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|
}
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|
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||||||
|
return config_interrupt(pin, flags);
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||||||
|
}
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|
static int gpio_esp32_write(struct device *dev, int access_op,
|
||||||
|
u32_t pin, u32_t value)
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|
{
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||||||
|
struct gpio_esp32_data *data = dev->driver_data;
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||||||
|
u32_t v;
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||||||
|
|
||||||
|
if (access_op != GPIO_ACCESS_BY_PIN) {
|
||||||
|
return -ENOTSUP;
|
||||||
|
}
|
||||||
|
|
||||||
|
v = BIT(pin - data->port.pin_offset);
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||||||
|
if (value) {
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|
*data->port.write.set_reg = v;
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||||||
|
} else {
|
||||||
|
*data->port.write.clear_reg = v;
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|
}
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int gpio_esp32_read(struct device *dev, int access_op,
|
||||||
|
u32_t pin, u32_t *value)
|
||||||
|
{
|
||||||
|
struct gpio_esp32_data *data = dev->driver_data;
|
||||||
|
u32_t v;
|
||||||
|
|
||||||
|
if (access_op != GPIO_ACCESS_BY_PIN) {
|
||||||
|
return -ENOTSUP;
|
||||||
|
}
|
||||||
|
|
||||||
|
v = *data->port.read.reg;
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||||||
|
*value = !!(v & BIT(pin - data->port.pin_offset));
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int gpio_esp32_manage_callback(struct device *dev,
|
||||||
|
struct gpio_callback *callback,
|
||||||
|
bool set)
|
||||||
|
{
|
||||||
|
struct gpio_esp32_data *data = dev->driver_data;
|
||||||
|
|
||||||
|
_gpio_manage_callback(&data->cb, callback, set);
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int gpio_esp32_enable_callback(struct device *dev,
|
||||||
|
int access_op, u32_t pin)
|
||||||
|
{
|
||||||
|
struct gpio_esp32_data *data = dev->driver_data;
|
||||||
|
|
||||||
|
if (access_op == GPIO_ACCESS_BY_PIN) {
|
||||||
|
data->cb_pins |= BIT(pin);
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
return -ENOTSUP;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int gpio_esp32_disable_callback(struct device *dev,
|
||||||
|
int access_op, u32_t pin)
|
||||||
|
{
|
||||||
|
struct gpio_esp32_data *data = dev->driver_data;
|
||||||
|
|
||||||
|
if (access_op == GPIO_ACCESS_BY_PIN) {
|
||||||
|
data->cb_pins &= ~BIT(pin);
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
return -ENOTSUP;
|
||||||
|
}
|
||||||
|
|
||||||
|
static void gpio_esp32_fire_callbacks(struct device *device)
|
||||||
|
{
|
||||||
|
struct gpio_esp32_data *data = device->driver_data;
|
||||||
|
u32_t values = *data->port.irq.status_reg;
|
||||||
|
|
||||||
|
if (values & data->cb_pins) {
|
||||||
|
_gpio_fire_callbacks(&data->cb, device, values);
|
||||||
|
}
|
||||||
|
|
||||||
|
*data->port.irq.ack_reg = values;
|
||||||
|
}
|
||||||
|
|
||||||
|
static void gpio_esp32_isr(void *param);
|
||||||
|
|
||||||
|
static int gpio_esp32_init(struct device *device)
|
||||||
|
{
|
||||||
|
struct gpio_esp32_data *data = device->driver_data;
|
||||||
|
static bool isr_connected;
|
||||||
|
|
||||||
|
data->pinmux = device_get_binding(CONFIG_PINMUX_NAME);
|
||||||
|
if (!data->pinmux) {
|
||||||
|
return -ENOTSUP;
|
||||||
|
}
|
||||||
|
|
||||||
|
if (!isr_connected) {
|
||||||
|
irq_disable(CONFIG_GPIO_ESP32_IRQ);
|
||||||
|
|
||||||
|
IRQ_CONNECT(CONFIG_GPIO_ESP32_IRQ, 1, gpio_esp32_isr,
|
||||||
|
NULL, 0);
|
||||||
|
|
||||||
|
intr_matrix_set(0, ETS_GPIO_INTR_SOURCE,
|
||||||
|
CONFIG_GPIO_ESP32_IRQ);
|
||||||
|
|
||||||
|
irq_enable(CONFIG_GPIO_ESP32_IRQ);
|
||||||
|
|
||||||
|
isr_connected = true;
|
||||||
|
}
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static const struct gpio_driver_api gpio_esp32_driver = {
|
||||||
|
.config = gpio_esp32_config,
|
||||||
|
.write = gpio_esp32_write,
|
||||||
|
.read = gpio_esp32_read,
|
||||||
|
.manage_callback = gpio_esp32_manage_callback,
|
||||||
|
.enable_callback = gpio_esp32_enable_callback,
|
||||||
|
.disable_callback = gpio_esp32_disable_callback,
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct gpio_esp32_data gpio_data_pins_0_to_31 = {
|
||||||
|
.port = {
|
||||||
|
.write = {
|
||||||
|
.set_reg = (u32_t *)GPIO_OUT_W1TS_REG,
|
||||||
|
.clear_reg = (u32_t *)GPIO_OUT_W1TC_REG,
|
||||||
|
},
|
||||||
|
.read = {
|
||||||
|
.reg = (u32_t *)GPIO_IN_REG,
|
||||||
|
},
|
||||||
|
.irq = {
|
||||||
|
.status_reg = (u32_t *)GPIO_STATUS_REG,
|
||||||
|
.ack_reg = (u32_t *)GPIO_STATUS_W1TC_REG,
|
||||||
|
},
|
||||||
|
.pin_offset = 0,
|
||||||
|
}
|
||||||
|
};
|
||||||
|
static struct gpio_esp32_data gpio_data_pins_32_to_63 = {
|
||||||
|
.port = {
|
||||||
|
.write = {
|
||||||
|
.set_reg = (u32_t *)GPIO_OUT1_W1TS_REG,
|
||||||
|
.clear_reg = (u32_t *)GPIO_OUT1_W1TC_REG,
|
||||||
|
},
|
||||||
|
.read = {
|
||||||
|
.reg = (u32_t *)GPIO_IN1_REG,
|
||||||
|
},
|
||||||
|
.irq = {
|
||||||
|
.status_reg = (u32_t *)GPIO_STATUS1_REG,
|
||||||
|
.ack_reg = (u32_t *)GPIO_STATUS1_W1TC_REG,
|
||||||
|
},
|
||||||
|
.pin_offset = 32,
|
||||||
|
}
|
||||||
|
};
|
||||||
|
|
||||||
|
#define GPIO_DEVICE_INIT(__name, __data_struct_name) \
|
||||||
|
DEVICE_AND_API_INIT(gpio_esp32_ ## __data_struct_name, \
|
||||||
|
__name, \
|
||||||
|
gpio_esp32_init, \
|
||||||
|
&gpio_data_pins_ ## __data_struct_name, \
|
||||||
|
NULL, \
|
||||||
|
POST_KERNEL, \
|
||||||
|
CONFIG_KERNEL_INIT_PRIORITY_DEVICE, \
|
||||||
|
&gpio_esp32_driver)
|
||||||
|
|
||||||
|
/* GPIOs are divided in two groups for ESP32 because the callback
|
||||||
|
* API works with 32-bit bitmasks to manage interrupt callbacks,
|
||||||
|
* and the device has 40 GPIO pins.
|
||||||
|
*/
|
||||||
|
#if defined(CONFIG_GPIO_ESP32_0)
|
||||||
|
GPIO_DEVICE_INIT(CONFIG_GPIO_ESP32_0_NAME, 0_to_31);
|
||||||
|
#endif
|
||||||
|
|
||||||
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#if defined(CONFIG_GPIO_ESP32_1)
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GPIO_DEVICE_INIT(CONFIG_GPIO_ESP32_1_NAME, 32_to_63);
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#endif
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static void gpio_esp32_isr(void *param)
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{
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#if defined(CONFIG_GPIO_ESP32_0)
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gpio_esp32_fire_callbacks(DEVICE_GET(gpio_esp32_0_to_31));
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#endif
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#if defined(CONFIG_GPIO_ESP32_1)
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||||||
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gpio_esp32_fire_callbacks(DEVICE_GET(gpio_esp32_32_to_63));
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||||||
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#endif
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ARG_UNUSED(param);
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}
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