dts: x86: intel: alder_lake: Added GPIO instances
Added GPIO instances supported on Alderlake platform Signed-off-by: Anisetti Avinash Krishna <anisetti.avinash.krishna@intel.com>
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@ -8,6 +8,7 @@
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#include <zephyr/dt-bindings/interrupt-controller/intel-ioapic.h>
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#include <zephyr/dt-bindings/i2c/i2c.h>
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#include <zephyr/dt-bindings/pcie/pcie.h>
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#include <zephyr/dt-bindings/gpio/gpio.h>
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/ {
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cpus {
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@ -110,6 +111,167 @@
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status = "okay";
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};
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gpio_0_b: gpio@fd6e0700 {
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compatible = "intel,gpio";
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reg = <0xfd6e0700 0x1000>;
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interrupts = <14 IRQ_TYPE_LOWEST_LEVEL_LOW 3>;
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interrupt-parent = <&intc>;
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group-index = <0x0>;
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||||
gpio-controller;
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#gpio-cells = <2>;
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ngpios = <24>;
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||||
pin-offset = <0>;
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status = "okay";
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};
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gpio_0_a: gpio@fd6e09a0 {
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compatible = "intel,gpio";
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reg = <0xfd6e09a0 0x1000>;
|
||||
interrupts = <14 IRQ_TYPE_LOWEST_LEVEL_LOW 3>;
|
||||
interrupt-parent = <&intc>;
|
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||||
group-index = <0x2>;
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||||
gpio-controller;
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||||
#gpio-cells = <2>;
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||||
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||||
ngpios = <24>;
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||||
pin-offset = <41>;
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||||
status = "okay";
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};
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||||
gpio_1_s: gpio@fd6d0700 {
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||||
compatible = "intel,gpio";
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||||
reg = <0xfd6d0700 0x1000>;
|
||||
interrupts = <14 IRQ_TYPE_LOWEST_LEVEL_LOW 3>;
|
||||
interrupt-parent = <&intc>;
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||||
group-index = <0x0>;
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||||
gpio-controller;
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||||
#gpio-cells = <2>;
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||||
ngpios = <8>;
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||||
pin-offset = <0>;
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||||
status = "okay";
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};
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||||
gpio_1_i: gpio@fd6d0780 {
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||||
compatible = "intel,gpio";
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reg = <0xfd6d0780 0x1000>;
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||||
interrupts = <14 IRQ_TYPE_LOWEST_LEVEL_LOW 3>;
|
||||
interrupt-parent = <&intc>;
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||||
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||||
group-index = <0x1>;
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||||
gpio-controller;
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||||
#gpio-cells = <2>;
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ngpios = <19>;
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pin-offset = <8>;
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||||
status = "okay";
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};
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||||
gpio_1_h: gpio@fd6d08c0 {
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||||
compatible = "intel,gpio";
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||||
reg = <0xfd6d08c0 0x1000>;
|
||||
interrupts = <14 IRQ_TYPE_LOWEST_LEVEL_LOW 3>;
|
||||
interrupt-parent = <&intc>;
|
||||
|
||||
group-index = <0x2>;
|
||||
gpio-controller;
|
||||
#gpio-cells = <2>;
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||||
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||||
ngpios = <24>;
|
||||
pin-offset = <25>;
|
||||
|
||||
status = "okay";
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};
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||||
gpio_1_d: gpio@fd6d0a40 {
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||||
compatible = "intel,gpio";
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||||
reg = <0xfd6d0a40 0x1000>;
|
||||
interrupts = <14 IRQ_TYPE_LOWEST_LEVEL_LOW 3>;
|
||||
interrupt-parent = <&intc>;
|
||||
|
||||
group-index = <0x3>;
|
||||
gpio-controller;
|
||||
#gpio-cells = <2>;
|
||||
|
||||
ngpios = <20>;
|
||||
pin-offset = <49>;
|
||||
|
||||
status = "okay";
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||||
};
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||||
gpio_4_c: gpio@fd6a0700 {
|
||||
compatible = "intel,gpio";
|
||||
reg = <0xfd6a0700 0x1000>;
|
||||
interrupts = <14 IRQ_TYPE_LOWEST_LEVEL_LOW 3>;
|
||||
interrupt-parent = <&intc>;
|
||||
|
||||
group-index = <0x0>;
|
||||
gpio-controller;
|
||||
#gpio-cells = <2>;
|
||||
|
||||
ngpios = <8>;
|
||||
pin-offset = <0>;
|
||||
|
||||
status = "okay";
|
||||
};
|
||||
|
||||
gpio_4_f: gpio@fd6a0880 {
|
||||
compatible = "intel,gpio";
|
||||
reg = <0xfd6a0880 0x1000>;
|
||||
interrupts = <14 IRQ_TYPE_LOWEST_LEVEL_LOW 3>;
|
||||
interrupt-parent = <&intc>;
|
||||
|
||||
group-index = <0x1>;
|
||||
gpio-controller;
|
||||
#gpio-cells = <2>;
|
||||
|
||||
ngpios = <24>;
|
||||
pin-offset = <24>;
|
||||
|
||||
status = "okay";
|
||||
};
|
||||
|
||||
gpio_4_e: gpio@fd6a0a70 {
|
||||
compatible = "intel,gpio";
|
||||
reg = <0xfd6a0a70 0x1000>;
|
||||
interrupts = <14 IRQ_TYPE_LOWEST_LEVEL_LOW 3>;
|
||||
interrupt-parent = <&intc>;
|
||||
|
||||
group-index = <0x3>;
|
||||
gpio-controller;
|
||||
#gpio-cells = <2>;
|
||||
|
||||
ngpios = <24>;
|
||||
pin-offset = <57>;
|
||||
|
||||
status = "okay";
|
||||
};
|
||||
|
||||
gpio_5_r: gpio@fd690700 {
|
||||
compatible = "intel,gpio";
|
||||
reg = <0xfd690700 0x1000>;
|
||||
interrupts = <14 IRQ_TYPE_LOWEST_LEVEL_LOW 3>;
|
||||
interrupt-parent = <&intc>;
|
||||
|
||||
group-index = <0x0>;
|
||||
gpio-controller;
|
||||
#gpio-cells = <2>;
|
||||
|
||||
ngpios = <8>;
|
||||
pin-offset = <0>;
|
||||
|
||||
status = "okay";
|
||||
};
|
||||
|
||||
hpet: hpet@fed00000 {
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||||
compatible = "intel,hpet";
|
||||
reg = <0xfed00000 0x400>;
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||||
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