drivers: pinctrl: esp32: initial support
add initial pinctrl driver support for ESP32. Signed-off-by: Glauber Maroto Ferreira <glauber.ferreira@espressif.com>
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Glauber Maroto Ferreira
Carles Cufí
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536e061181
commit
135f4f772a
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@ -18,3 +18,4 @@ zephyr_library_sources_ifdef(CONFIG_PINCTRL_MCUX_RT pinctrl_mcux_rt.c)
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zephyr_library_sources_ifdef(CONFIG_PINCTRL_SIFIVE pinctrl_sifive.c)
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zephyr_library_sources_ifdef(CONFIG_PINCTRL_SIFIVE pinctrl_sifive.c)
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zephyr_library_sources_ifdef(CONFIG_PINCTRL_NXP_IOCON pinctrl_lpc_iocon.c)
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zephyr_library_sources_ifdef(CONFIG_PINCTRL_NXP_IOCON pinctrl_lpc_iocon.c)
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zephyr_library_sources_ifdef(CONFIG_PINCTRL_CC13XX_CC26XX pinctrl_cc13xx_cc26xx.c)
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zephyr_library_sources_ifdef(CONFIG_PINCTRL_CC13XX_CC26XX pinctrl_cc13xx_cc26xx.c)
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zephyr_library_sources_ifdef(CONFIG_PINCTRL_ESP32 pinctrl_esp32.c)
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@ -43,5 +43,6 @@ source "drivers/pinctrl/Kconfig.mcux"
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source "drivers/pinctrl/Kconfig.sifive"
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source "drivers/pinctrl/Kconfig.sifive"
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source "drivers/pinctrl/Kconfig.lpc_iocon"
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source "drivers/pinctrl/Kconfig.lpc_iocon"
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||||||
source "drivers/pinctrl/Kconfig.cc13xx_cc26xx"
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source "drivers/pinctrl/Kconfig.cc13xx_cc26xx"
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source "drivers/pinctrl/Kconfig.esp32"
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endif # PINCTRL
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endif # PINCTRL
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11
drivers/pinctrl/Kconfig.esp32
Normal file
11
drivers/pinctrl/Kconfig.esp32
Normal file
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@ -0,0 +1,11 @@
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# Copyright (c) 2022 Espressif Systems (Shanghai) Co., Ltd.
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# SPDX-License-Identifier: Apache-2.0
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DT_COMPAT_ESP32_PINCTRL := espressif,esp32-pinctrl
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config PINCTRL_ESP32
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|
bool "Pin controller driver for ESP32 SoC"
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depends on SOC_ESP32
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default $(dt_compat_enabled,$(DT_COMPAT_ESP32_PINCTRL))
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help
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|
Enable pin controller driver for ESP32 SoC
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286
drivers/pinctrl/pinctrl_esp32.c
Normal file
286
drivers/pinctrl/pinctrl_esp32.c
Normal file
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@ -0,0 +1,286 @@
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/*
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|
* Copyright (c) 2022 Espressif Systems (Shanghai) Co., Ltd.
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*
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|
* SPDX-License-Identifier: Apache-2.0
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*/
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/* Include esp-idf headers first to avoid redefining BIT() macro */
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#include <hal/gpio_ll.h>
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#include <hal/rtc_io_hal.h>
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#include <soc.h>
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#include <drivers/pinctrl.h>
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#include <drivers/pinctrl/pinctrl_esp32_common.h>
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#ifdef CONFIG_SOC_ESP32C3
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/* gpio structs in esp32c3 series are different from xtensa ones */
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#define out out.data
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#define in in.data
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#define out_w1ts out_w1ts.val
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#define out_w1tc out_w1tc.val
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#endif
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#ifndef SOC_GPIO_SUPPORT_RTC_INDEPENDENT
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#define SOC_GPIO_SUPPORT_RTC_INDEPENDENT 0
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#endif
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#define ESP32_INVALID_PORT_ADDR 0UL
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#define ESP32_GPIO_PORT_ADDR(nodelabel) \
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|
COND_CODE_1(DT_NODE_EXISTS(DT_NODELABEL(nodelabel)), \
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|
(DT_REG_ADDR(DT_NODELABEL(nodelabel)),), \
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|
(ESP32_INVALID_PORT_ADDR))
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/**
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|
* @brief Array containing each GPIO port address.
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|
*
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||||||
|
* Entries will be an invalid address if the port is not enabled.
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*/
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static const uint32_t esp32_gpio_ports_addrs[] = {
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||||||
|
ESP32_GPIO_PORT_ADDR(gpio0)
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||||||
|
ESP32_GPIO_PORT_ADDR(gpio1)
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||||||
|
};
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||||||
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|
||||||
|
/** Number of GPIO ports. */
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|
static const size_t esp32_gpio_ports_cnt = ARRAY_SIZE(esp32_gpio_ports_addrs);
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||||||
|
static inline bool rtc_gpio_is_valid_gpio(uint32_t gpio_num)
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||||||
|
{
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||||||
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#if SOC_RTCIO_INPUT_OUTPUT_SUPPORTED
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||||||
|
return (gpio_num < SOC_GPIO_PIN_COUNT && rtc_io_num_map[gpio_num] >= 0);
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||||||
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#else
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return false;
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||||||
|
#endif
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|
}
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static inline bool esp32_pin_is_valid(uint32_t pin)
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{
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return ((BIT(pin) & SOC_GPIO_VALID_GPIO_MASK) != 0);
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|
}
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||||||
|
static inline bool esp32_pin_is_output_capable(uint32_t pin)
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|
{
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||||||
|
return ((BIT(pin) & SOC_GPIO_VALID_OUTPUT_GPIO_MASK) != 0);
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||||||
|
}
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|
static int esp32_pin_apply_config(uint32_t pin, uint32_t flags)
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{
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|
gpio_dev_t *const gpio_base = (gpio_dev_t *)DT_REG_ADDR(DT_NODELABEL(gpio0));
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||||||
|
uint32_t io_pin = (uint32_t) pin + ((ESP32_PORT_IDX(pin) == 1 && pin < 32) ? 32 : 0);
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int ret = 0;
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||||||
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||||||
|
if (!esp32_pin_is_valid(io_pin)) {
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||||||
|
return -EINVAL;
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||||||
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}
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||||||
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|
#if SOC_RTCIO_INPUT_OUTPUT_SUPPORTED
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||||||
|
if (rtc_gpio_is_valid_gpio(io_pin)) {
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||||||
|
rtcio_hal_function_select(rtc_io_num_map[io_pin], RTCIO_FUNC_DIGITAL);
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||||||
|
}
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||||||
|
#endif
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||||||
|
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||||||
|
if (io_pin >= GPIO_NUM_MAX) {
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||||||
|
ret = -EINVAL;
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|
goto end;
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||||||
|
}
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||||||
|
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/* Set pin function as GPIO */
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|
gpio_ll_iomux_func_sel(GPIO_PIN_MUX_REG[io_pin], PIN_FUNC_GPIO);
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||||||
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||||||
|
if (flags & ESP32_PULL_UP_FLAG) {
|
||||||
|
if (!rtc_gpio_is_valid_gpio(io_pin) || SOC_GPIO_SUPPORT_RTC_INDEPENDENT) {
|
||||||
|
gpio_ll_pulldown_dis(&GPIO, io_pin);
|
||||||
|
gpio_ll_pullup_en(&GPIO, io_pin);
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||||||
|
} else {
|
||||||
|
#if SOC_RTCIO_INPUT_OUTPUT_SUPPORTED
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||||||
|
int rtcio_num = rtc_io_num_map[io_pin];
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||||||
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|
||||||
|
rtcio_hal_pulldown_disable(rtc_io_num_map[io_pin]);
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||||||
|
|
||||||
|
if (rtc_io_desc[rtcio_num].pullup) {
|
||||||
|
rtcio_hal_pullup_enable(rtc_io_num_map[io_pin]);
|
||||||
|
} else {
|
||||||
|
ret = -ENOTSUP;
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||||||
|
goto end;
|
||||||
|
}
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||||||
|
#endif
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||||||
|
}
|
||||||
|
} else if (flags & ESP32_PULL_DOWN_FLAG) {
|
||||||
|
if (!rtc_gpio_is_valid_gpio(io_pin) || SOC_GPIO_SUPPORT_RTC_INDEPENDENT) {
|
||||||
|
gpio_ll_pullup_dis(&GPIO, io_pin);
|
||||||
|
gpio_ll_pulldown_en(&GPIO, io_pin);
|
||||||
|
} else {
|
||||||
|
#if SOC_RTCIO_INPUT_OUTPUT_SUPPORTED
|
||||||
|
int rtcio_num = rtc_io_num_map[io_pin];
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||||||
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|
||||||
|
rtcio_hal_pulldown_enable(rtc_io_num_map[io_pin]);
|
||||||
|
|
||||||
|
if (rtc_io_desc[rtcio_num].pullup) {
|
||||||
|
rtcio_hal_pullup_disable(rtc_io_num_map[io_pin]);
|
||||||
|
} else {
|
||||||
|
ret = -ENOTSUP;
|
||||||
|
goto end;
|
||||||
|
}
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|
#endif
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|
}
|
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|
}
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|
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|
if (flags & ESP32_DIR_OUT_FLAG) {
|
||||||
|
if (!esp32_pin_is_output_capable(pin)) {
|
||||||
|
ret = -EINVAL;
|
||||||
|
goto end;
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|
}
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|
|
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|
if (flags & ESP32_OPEN_DRAIN_FLAG) {
|
||||||
|
gpio_ll_od_enable(gpio_base, io_pin);
|
||||||
|
} else {
|
||||||
|
gpio_ll_od_disable(gpio_base, io_pin);
|
||||||
|
}
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|
/* Set output pin initial value */
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|
if (flags & ESP32_PIN_OUT_HIGH_FLAG) {
|
||||||
|
gpio_ll_set_level(gpio_base, io_pin, 1);
|
||||||
|
} else if (flags & ESP32_PIN_OUT_LOW_FLAG) {
|
||||||
|
gpio_ll_set_level(gpio_base, io_pin, 0);
|
||||||
|
}
|
||||||
|
|
||||||
|
gpio_ll_output_enable(&GPIO, io_pin);
|
||||||
|
esp_rom_gpio_matrix_out(io_pin, SIG_GPIO_OUT_IDX, false, false);
|
||||||
|
} else {
|
||||||
|
gpio_ll_output_disable(&GPIO, io_pin);
|
||||||
|
}
|
||||||
|
|
||||||
|
if (flags & ESP32_DIR_INP_FLAG) {
|
||||||
|
gpio_ll_input_enable(&GPIO, io_pin);
|
||||||
|
} else {
|
||||||
|
gpio_ll_input_disable(&GPIO, io_pin);
|
||||||
|
}
|
||||||
|
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||||||
|
end:
|
||||||
|
return ret;
|
||||||
|
}
|
||||||
|
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|
static int esp32_pin_configure(const uint32_t pin_mux, const uint32_t pin_cfg)
|
||||||
|
{
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||||||
|
uint32_t port_addr;
|
||||||
|
uint32_t pin_num = ESP32_PIN_NUM(pin_mux);
|
||||||
|
uint32_t sig_in = ESP32_PIN_SIGI(pin_mux);
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||||||
|
uint32_t sig_out = ESP32_PIN_SIGO(pin_mux);
|
||||||
|
uint32_t flags = 0;
|
||||||
|
|
||||||
|
if (ESP32_PORT_IDX(pin_num) >= esp32_gpio_ports_cnt) {
|
||||||
|
return -EINVAL;
|
||||||
|
}
|
||||||
|
|
||||||
|
port_addr = esp32_gpio_ports_addrs[ESP32_PORT_IDX(pin_num)];
|
||||||
|
|
||||||
|
if (port_addr == ESP32_INVALID_PORT_ADDR) {
|
||||||
|
return -EINVAL;
|
||||||
|
}
|
||||||
|
|
||||||
|
switch (ESP32_PIN_BIAS(pin_cfg)) {
|
||||||
|
case ESP32_PULL_UP:
|
||||||
|
flags |= ESP32_PULL_UP_FLAG;
|
||||||
|
break;
|
||||||
|
case ESP32_PULL_DOWN:
|
||||||
|
flags |= ESP32_PULL_DOWN_FLAG;
|
||||||
|
break;
|
||||||
|
default:
|
||||||
|
break;
|
||||||
|
}
|
||||||
|
|
||||||
|
switch (ESP32_PIN_DRV(pin_cfg)) {
|
||||||
|
case ESP32_PUSH_PULL:
|
||||||
|
flags |= ESP32_PUSH_PULL_FLAG;
|
||||||
|
break;
|
||||||
|
case ESP32_OPEN_DRAIN:
|
||||||
|
flags |= ESP32_OPEN_DRAIN_FLAG;
|
||||||
|
break;
|
||||||
|
default:
|
||||||
|
break;
|
||||||
|
}
|
||||||
|
|
||||||
|
if (sig_in == ESP_SIG_INVAL && sig_out == ESP_SIG_INVAL) {
|
||||||
|
return -ENOTSUP;
|
||||||
|
}
|
||||||
|
|
||||||
|
if (sig_in != ESP_SIG_INVAL) {
|
||||||
|
flags |= ESP32_DIR_INP_FLAG;
|
||||||
|
}
|
||||||
|
|
||||||
|
if (sig_out != ESP_SIG_INVAL) {
|
||||||
|
flags |= ESP32_DIR_OUT_FLAG;
|
||||||
|
}
|
||||||
|
|
||||||
|
switch (ESP32_PIN_MODE_OUT(pin_cfg)) {
|
||||||
|
case ESP32_PIN_OUT_HIGH:
|
||||||
|
flags |= ESP32_PIN_OUT_HIGH_FLAG;
|
||||||
|
break;
|
||||||
|
case ESP32_PIN_OUT_LOW:
|
||||||
|
flags |= ESP32_PIN_OUT_LOW_FLAG;
|
||||||
|
break;
|
||||||
|
default:
|
||||||
|
break;
|
||||||
|
}
|
||||||
|
|
||||||
|
if (flags & ESP32_PIN_OUT_HIGH_FLAG) {
|
||||||
|
if (ESP32_PORT_IDX(pin_num) == 0) {
|
||||||
|
gpio_dev_t *const gpio_dev =
|
||||||
|
(gpio_dev_t *)DT_REG_ADDR(DT_NODELABEL(gpio0));
|
||||||
|
gpio_dev->out_w1ts = pin_num;
|
||||||
|
#if DT_NODE_HAS_STATUS(DT_NODELABEL(gpio1), okay)
|
||||||
|
} else {
|
||||||
|
gpio_dev_t *const gpio_dev =
|
||||||
|
(gpio_dev_t *)DT_REG_ADDR(DT_NODELABEL(gpio1));
|
||||||
|
gpio_dev->out1_w1ts.data = pin_num;
|
||||||
|
#endif
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
if (flags & ESP32_PIN_OUT_LOW_FLAG) {
|
||||||
|
if (ESP32_PORT_IDX(pin_num) == 0) {
|
||||||
|
gpio_dev_t *const gpio_dev =
|
||||||
|
(gpio_dev_t *)DT_REG_ADDR(DT_NODELABEL(gpio0));
|
||||||
|
gpio_dev->out_w1tc = pin_num;
|
||||||
|
#if DT_NODE_HAS_STATUS(DT_NODELABEL(gpio1), okay)
|
||||||
|
} else {
|
||||||
|
gpio_dev_t *const gpio_dev =
|
||||||
|
(gpio_dev_t *)DT_REG_ADDR(DT_NODELABEL(gpio1));
|
||||||
|
gpio_dev->out1_w1tc.data = pin_num;
|
||||||
|
#endif
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
esp32_pin_apply_config(pin_num, flags);
|
||||||
|
|
||||||
|
if (flags & ESP32_DIR_OUT_FLAG) {
|
||||||
|
esp_rom_gpio_matrix_out(pin_num, sig_out, 0, 0);
|
||||||
|
}
|
||||||
|
|
||||||
|
if (flags & ESP32_DIR_INP_FLAG) {
|
||||||
|
esp_rom_gpio_matrix_in(pin_num, sig_in, 0);
|
||||||
|
}
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
int pinctrl_configure_pins(const pinctrl_soc_pin_t *pins, uint8_t pin_cnt,
|
||||||
|
uintptr_t reg)
|
||||||
|
{
|
||||||
|
uint32_t pin_mux, pin_cfg;
|
||||||
|
int ret = 0;
|
||||||
|
|
||||||
|
ARG_UNUSED(reg);
|
||||||
|
|
||||||
|
for (uint8_t i = 0U; i < pin_cnt; i++) {
|
||||||
|
pin_mux = pins[i].pinmux;
|
||||||
|
pin_cfg = pins[i].pincfg;
|
||||||
|
|
||||||
|
ret = esp32_pin_configure(pin_mux, pin_cfg);
|
||||||
|
if (ret < 0) {
|
||||||
|
return ret;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
31
include/drivers/pinctrl/pinctrl_esp32_common.h
Normal file
31
include/drivers/pinctrl/pinctrl_esp32_common.h
Normal file
|
|
@ -0,0 +1,31 @@
|
||||||
|
/*
|
||||||
|
* Copyright (c) 2022 Espressif Systems (Shanghai) Co., Ltd.
|
||||||
|
*
|
||||||
|
* SPDX-License-Identifier: Apache-2.0
|
||||||
|
*/
|
||||||
|
|
||||||
|
#ifndef ZEPHYR_INCLUDE_DRIVERS_PINCTRL_PINCTRL_ESP32_COMMON_H_
|
||||||
|
#define ZEPHYR_INCLUDE_DRIVERS_PINCTRL_PINCTRL_ESP32_COMMON_H_
|
||||||
|
|
||||||
|
#define ESP32_PORT_IDX(_pin) \
|
||||||
|
(((_pin) < 32) ? 0 : 1)
|
||||||
|
|
||||||
|
#define ESP32_PIN_NUM(_mux) \
|
||||||
|
(((_mux) >> ESP32_PIN_NUM_SHIFT) & ESP32_PIN_NUM_MASK)
|
||||||
|
|
||||||
|
#define ESP32_PIN_SIGI(_mux) \
|
||||||
|
(((_mux) >> ESP32_PIN_SIGI_SHIFT) & ESP32_PIN_SIGI_MASK)
|
||||||
|
|
||||||
|
#define ESP32_PIN_SIGO(_mux) \
|
||||||
|
(((_mux) >> ESP32_PIN_SIGO_SHIFT) & ESP32_PIN_SIGO_MASK)
|
||||||
|
|
||||||
|
#define ESP32_PIN_BIAS(_cfg) \
|
||||||
|
(((_cfg) >> ESP32_PIN_BIAS_SHIFT) & ESP32_PIN_BIAS_MASK)
|
||||||
|
|
||||||
|
#define ESP32_PIN_DRV(_cfg) \
|
||||||
|
(((_cfg) >> ESP32_PIN_DRV_SHIFT) & ESP32_PIN_DRV_MASK)
|
||||||
|
|
||||||
|
#define ESP32_PIN_MODE_OUT(_cfg) \
|
||||||
|
(((_cfg) >> ESP32_PIN_OUT_SHIFT) & ESP32_PIN_OUT_MASK)
|
||||||
|
|
||||||
|
#endif /* ZEPHYR_INCLUDE_DRIVERS_PINCTRL_PINCTRL_ESP32_COMMON_H_ */
|
||||||
75
soc/xtensa/esp32/pinctrl_soc.h
Normal file
75
soc/xtensa/esp32/pinctrl_soc.h
Normal file
|
|
@ -0,0 +1,75 @@
|
||||||
|
/*
|
||||||
|
* Copyright (c) 2022 Espressif Systems (Shanghai) Co., Ltd.
|
||||||
|
*
|
||||||
|
* SPDX-License-Identifier: Apache-2.0
|
||||||
|
*/
|
||||||
|
|
||||||
|
/**
|
||||||
|
* @file
|
||||||
|
* ESP32 SoC specific helpers for pinctrl driver
|
||||||
|
*/
|
||||||
|
|
||||||
|
#ifndef ZEPHYR_SOC_XTENSA_ESP32_PINCTRL_SOC_H_
|
||||||
|
#define ZEPHYR_SOC_XTENSA_ESP32_PINCTRL_SOC_H_
|
||||||
|
|
||||||
|
#include <devicetree.h>
|
||||||
|
#include <zephyr/types.h>
|
||||||
|
|
||||||
|
#include <dt-bindings/pinctrl/esp-pinctrl-common.h>
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/** @cond INTERNAL_HIDDEN */
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/** Type for ESP32 pin. */
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typedef struct pinctrl_soc_pin {
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/** Pinmux settings (pin, direction and signal). */
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uint32_t pinmux;
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/** Pincfg settings (bias). */
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uint32_t pincfg;
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} pinctrl_soc_pin_t;
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/**
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* @brief Utility macro to initialize pinmux field in #pinctrl_pin_t.
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*
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* @param node_id Node identifier.
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*/
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#define Z_PINCTRL_ESP32_PINMUX_INIT(node_id) DT_PROP(node_id, pinmux)
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/**
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* @brief Utility macro to initialize pincfg field in #pinctrl_pin_t.
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*
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* @param node_id Node identifier.
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*/
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#define Z_PINCTRL_ESP32_PINCFG_INIT(node_id) \
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(((ESP32_NO_PULL * DT_PROP(node_id, bias_disable)) << ESP32_PIN_BIAS_SHIFT) | \
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((ESP32_PULL_UP * DT_PROP(node_id, bias_pull_up)) << ESP32_PIN_BIAS_SHIFT) | \
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((ESP32_PULL_DOWN * DT_PROP(node_id, bias_pull_down)) << ESP32_PIN_BIAS_SHIFT) | \
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((ESP32_PUSH_PULL * DT_PROP(node_id, drive_push_pull)) << ESP32_PIN_DRV_SHIFT) | \
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((ESP32_OPEN_DRAIN * DT_PROP(node_id, drive_open_drain)) << ESP32_PIN_DRV_SHIFT) | \
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((ESP32_PIN_OUT_HIGH * DT_PROP(node_id, output_high)) << ESP32_PIN_OUT_SHIFT) | \
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((ESP32_PIN_OUT_LOW * DT_PROP(node_id, output_low)) << ESP32_PIN_OUT_SHIFT))
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/**
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* @brief Utility macro to initialize each pin.
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*
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* @param node_id Node identifier.
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* @param state_prop State property name.
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* @param idx State property entry index.
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*/
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#define Z_PINCTRL_STATE_PIN_INIT(node_id, state_prop, idx) \
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{ .pinmux = Z_PINCTRL_ESP32_PINMUX_INIT( \
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DT_PROP_BY_IDX(node_id, state_prop, idx)), \
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.pincfg = Z_PINCTRL_ESP32_PINCFG_INIT( \
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DT_PROP_BY_IDX(node_id, state_prop, idx)) },
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/**
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* @brief Utility macro to initialize state pins contained in a given property.
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*
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* @param node_id Node identifier.
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* @param prop Property name describing state pins.
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*/
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#define Z_PINCTRL_STATE_PINS_INIT(node_id, prop) \
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{DT_FOREACH_PROP_ELEM(node_id, prop, Z_PINCTRL_STATE_PIN_INIT)}
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/** @endcond */
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#endif /* ZEPHYR_SOC_XTENSA_ESP32_PINCTRL_SOC_H_ */
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